P2PPC440 core implementation
This course covers the IBM Power 445 core
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Objectives
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- Experience of a 32 bit processor or DSP is mandatory.
- Cours théorique
- Support de cours au format PDF (en anglais) et une version imprimée lors des sessions en présentiel
- Cours dispensé via le système de visioconférence Teams (si à distance)
- Le formateur répond aux questions des stagiaires en direct pendant la formation et fournit une assistance technique et pédagogique
- Au début de chaque demi-journée une période est réservée à une interaction avec les stagiaires pour s'assurer que le cours répond à leurs attentes et l'adapter si nécessaire
- Tout ingénieur ou technicien en systèmes embarqués possédant les prérequis ci-dessus.
- Les prérequis indiqués ci-dessus sont évalués avant la formation par l'encadrement technique du stagiaire dans son entreprise, ou par le stagiaire lui-même dans le cas exceptionnel d'un stagiaire individuel.
- Les progrès des stagiaires sont évalués par des quizz proposés en fin des sections pour vérifier que les stagiaires ont assimilé les points présentés
- En fin de formation, une attestation et un certificat attestant que le stagiaire a suivi le cours avec succès.
- En cas de problème dû à un manque de prérequis de la part du stagiaire, constaté lors de la formation, une formation différente ou complémentaire lui est proposée, en général pour conforter ses prérequis, en accord avec son responsable en entreprise le cas échéant.
Plan du cours
- Internal architecture overview
- Connection to peripheral IPs
- Clocking
- Programming model
- Pipeline basics
- 5-stage pipeline operation
- Speculative execution, guarded memory
- Cache basics
- Data flow between external memory and caches
- Cache programming interface
- Process vs thread
- Memory Management Unit
- Translation Lookaside Buffer initialisation
- Cache control and debugging features
- Load / store buffer, speculative loads
- Book E objectives
- Branch instructions
- Load / store instructions
- Semaphore management with lwarx / stwcx. Instructions
- Arithmetical and logical instructions
- The PowerPC EABI
- Cache related instructions
- 16-bit mac instructions to develop fixed point DSP algorithms
- Exception processing
- Syndrome registers updating when an exception is taken
- Core timers : PIT, FIT and WDT
- Reset
- JTAG emulator use
- Real time trace when the PowerPC core executes cached instructions
- Hardware vs software breakpoints
- External connections
- Clock and power management interface
- CPU control interface
- Reset interface
- External interrupt controller interface
- Instruction-side local bus interface
- Data-side local bus interface
- DCR interface
- Connection to the native instruction pipeline
- External coprocessor module
- Software interface
- Class of instruction
- Developing a custom instruction set relying on an external coprocessor
- Floating point simple and double precision instructions
Plus d'information
Pour vous enregistrer ou pour toute information supplémentaire, contactez nous par email à l'adresse info@ac6-formation.com.
Les inscriptions aux sessions de formation sont acceptées jusqu'à une semaine avant le début de la formation. Pour une inscription plus tardive nous consulter
Vous pouvez aussi remplir et nous envoyer le bulletin d'inscription
Ce cours peut être dispensé dans notre centre de formation près de Paris ou dans vos locaux, en France ou dans le monde entier.
Les sessions inter-entreprises programmées sont ouvertes dès deux inscrits. Sous condition d'un dossier complet, les inscriptions sont acceptées jusqu'à une semaine avant le début de la formation.
Dernière mise à jour du plan de cours : 19 février 2023
L'inscription à nos formations est soumise à nos Conditions Générales de Vente