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Renseignements
IM3

DSI 1.1

This course covers the Display Serial Interface V1.1 (DSI 1.1)

Objectives

  • The course starts with an overview of MIPI specification.
  • The layers are described using a bottom-top approach, starting with D-PHY and ending with DSI.
  • Forward and Reverse capabilities of a D-PHY are studied.
  • The course details the electrical characteristics of D-PHY.
  • Access to configuration and status registers through Reverse direction is covered.
  • Multi-lane distribution and merging of packets is explained.
  • The course focuses on the low level protocol, based on short and long packets used to transport images, embedded data and framing informations.
  • Data formats and possible compression of raw data is detailed to understand how the long packet payload is organized.
  • Companies interested in attending this course must adhere to MIPI organization.
  • This course has been designed for engineers in charge of SoC architecture, functional verification or silicon validation.

A more detailed course description is available on request at training@ac6-training.com
  • Basic knowledge on video transport.
  • Cours théorique
    • Support PDF (en anglais), imprimé en présentiel ; à distance via Teams.
    • Assistance du formateur tout au long de la formation.
  • Chaque session débute par un point avec les stagiaires.
  • Tout ingénieur ou technicien en systèmes embarqués possédant les prérequis ci-dessus.
  • Les prérequis sont vérifiés avant l'entrée en formation, sur la base des prérequis publiés sur cette fiche.
  • Pendant la formation, les acquis sont évalués en continu : quiz de fin de séquence et observation directe du formateur.
  • À l'issue de la formation, chaque participant reçoit une attestation de fin de formation.

Plan du cours

  • Universal lane module architecture
  • Control character usage
  • Uni-directional data lanes
  • Bi-directional data lanes, turnaround procedure
  • Clock lane
  • High-Speed data transmission in bursts
  • System power states
  • Low power states, escape mode
  • Low power data transmission
  • High-Speed clock transmission
  • Fault detection
  • Display architecture
  • Power level definition
  • Self-diagnostic functions
  • Command description
  • Pixel-to-byte mapping
  • Overview
  • Physical layer, flow control
  • Multi-Lane Distribution and Merging
  • Low-Level Protocol Errors and Contention
  • DSI protocol
  • DSI conformance test suite
  • DSI interoperability test suite
Durée
1 jour
Renseignements

Ce cours peut être organisé sur demande. Cliquez sur le bouton 'Renseignements' pour nous contacter.

Tarifs

Formations proposées sur devis, sans tarif catalogue. Le tarif dépend de la durée, du nombre de participants, de la modalité et des moyens techniques mis à disposition.

Pour plus d'informations sur notre tarification, en savoir plus.

Plus d'information

Pour vous enregistrer ou pour toute information supplémentaire, contactez nous par email à l'adresse info@ac6-formation.com.

Les inscriptions aux sessions de formation sont acceptées jusqu'à une semaine avant le début de la formation. Pour une inscription plus tardive nous consulter

Vous pouvez aussi remplir et nous envoyer le bulletin d'inscription

Ce cours peut être dispensé dans notre centre de formation près de Paris ou dans vos locaux, en France ou dans le monde entier.

Les sessions inter-entreprises programmées sont ouvertes dès deux inscrits. Sous condition d'un dossier complet, les inscriptions sont acceptées jusqu'à une semaine avant le début de la formation.

Dernière mise à jour du plan de cours : 2 juillet 2026

L'inscription à nos formations est soumise à nos Conditions Générales de Vente

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