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Renseignements
FCC3

e200z7 implementation

This course covers the e200z7 core present in NXP MPC56XX MCUs

Objectives

  • This course has 5 main objectives:
    • Learning the exception mechanism, providing guidelines to implement nesting
    • Explaining the operation and initialization of the MMU and caches
    • Highlighting the cache coherency issues and explaining the snooping
    • Detailing low level programming, particularly the floating-point and SPE instructions
    • Describing the debug units.

  • ACSYS has developed an optimized SPE based FFT coded in assembler language.
  • For any information contact training@ac6-training.com
A more detailed course description is available on request at training@ac6-training.com
  • Experience of a 32-bit processor or DSP is mandatory.
  • Cours théorique
    • Support PDF (en anglais), imprimé en présentiel ; à distance via Teams.
    • Assistance du formateur tout au long de la formation.
  • Chaque session débute par un point avec les stagiaires.
  • Tout ingénieur ou technicien en systèmes embarqués possédant les prérequis ci-dessus.
  • Les prérequis sont vérifiés avant l'entrée en formation, sur la base des prérequis publiés sur cette fiche.
  • Pendant la formation, les acquis sont évalués en continu : quiz de fin de séquence et observation directe du formateur.
  • À l'issue de la formation, chaque participant reçoit une attestation de fin de formation.

Plan du cours

  • e200 core family
  • Main blocks, pipeline, MMU, cache, timers, debug unit
  • Prefetch queue
  • Decode / dispatch stage
  • Concurrent Instruction Issue Capabilities
  • In order execution
  • Completion, register write-back
  • Dynamic vs static branch prediction
  • Guarded memory
  • Building the exception vector table
  • Exception taking sequence
  • Implementing nesting among maskable interrupts
  • Reset sequence
  • Studying cache reload transients
  • Line-fill buffers
  • Memory synchronization
  • Spin-lock routine
  • Assigning attributes to pages
  • Assigning access permissions to page
  • Page protection
  • MMU-related exceptions
  • 64-entry, fully associative TLB
  • TLB software reload, using MAS registers
  • 4 way set-associative Harvard instruction and data caches
  • Data and instruction prefetch instructions
  • Cache software control, cache line lock
  • Coherency issues when cacheable pages are shared with DMA
  • Cache parity and EDC protection
  • Cache memory access via software
  • System integrity checking
  • Monitoring the internal CPU read and write buses
  • EABI, small sections
  • Tricky instructions
  • C coding guidelines
  • Half-precision floating-point format
  • Floating point simple precision & double precision scalar instructions
  • Floating point vector instructions
  • Fixed point vector instructions, fractional format
  • Vector data arrangement instructions
  • Managing a circular buffer
  • VLE storage addressing
  • MMU extensions
  • Summary of instruction set
  • 64-bit time base
  • Decrementer
  • Software watchdog
  • Performance monitor
  • Nexus Class 3+ real-time development unit
  • Hardware instruction and data breakpoints
  • Debug interrupt
  • Debug notify halt instruction
  • Using debug data acquisition message
  • Watchpoint programming
  • Instruction and data trace
  • Power-saving modes: doze, nap, sleep, and wait
  • Debug considerations for power management
Durée
3 jours
Renseignements

Ce cours peut être organisé sur demande. Cliquez sur le bouton 'Renseignements' pour nous contacter.

Tarifs

Formations proposées sur devis, sans tarif catalogue. Le tarif dépend de la durée, du nombre de participants, de la modalité et des moyens techniques mis à disposition.

Pour plus d'informations sur notre tarification, en savoir plus.

Plus d'information

Pour vous enregistrer ou pour toute information supplémentaire, contactez nous par email à l'adresse info@ac6-formation.com.

Les inscriptions aux sessions de formation sont acceptées jusqu'à une semaine avant le début de la formation. Pour une inscription plus tardive nous consulter

Vous pouvez aussi remplir et nous envoyer le bulletin d'inscription

Ce cours peut être dispensé dans notre centre de formation près de Paris ou dans vos locaux, en France ou dans le monde entier.

Les sessions inter-entreprises programmées sont ouvertes dès deux inscrits. Sous condition d'un dossier complet, les inscriptions sont acceptées jusqu'à une semaine avant le début de la formation.

Dernière mise à jour du plan de cours : 2 juillet 2026

L'inscription à nos formations est soumise à nos Conditions Générales de Vente

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