Formation AMD Zynq All Programmable SoC: Hardware and Software Design | Ac6 Training

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Renseignements
HX5AMD Zynq All Programmable SoC: Hardware and Software Design
This course explains how to design a System on Chip (SoC) based on the AMD Zynq-7000 All Programmable SoC

Objectives

  • Describing how to build a complete Embedded System based on the Zynq (Processing System with an ARM Cortex-A9MP Core + FPGA)
  • Describing the Zynq Implementation, the Vivado IP Integrator tool and the Software Development Kit (SDK) tools to create a hardware platform and the software to program it
  • Working with AMD (Xilinx) tools like Chipscope and the SDK Remote Debugging to debug the Software and the Hardware
  • Booting the Linux Kernel on the platform and Executing Linux OS based Applications
  • Creating a User IP and the corresponding Linux Driver and integrating it to the System
  • Basic knowledge on processor and FPGA technology
  • Knowledge of VHDL and C languages
  • Cours théorique
    • Support PDF (en anglais), imprimé en présentiel ; à distance via Teams.
    • Assistance du formateur tout au long de la formation.
  • Activités pratiques (40-50% de la durée)
    • Exemples de code, exercices et solutions.
    • À distance : un PC Linux en ligne par stagiaire, avec carte émulée ou physique selon le cours.
    • Présentiel / sur site : un PC (un par binôme au-delà de 6 stagiaires), carte cible et manuel d'installation si nécessaire.
  • Machine virtuelle préconfigurée téléchargeable pour refaire les TP après le cours.
  • Chaque session débute par un point avec les stagiaires.
  • Tout ingénieur ou technicien en systèmes embarqués possédant les prérequis ci-dessus.
  • Les prérequis sont évalués avant la formation.
  • Les progrès sont évalués par le formateur via les exercices pratiques, et par des quizz pour les sections sans exercices.
  • Chaque stagiaire reçoit une attestation de réussite.
  • En cas de prérequis manquant, une formation différente ou complémentaire est proposée.

Plan du cours

  • Processing System
  • Programmable Logic
  • Interfacing and signals
  • Interconnects
  • Memory
  • Interrupts
  • Tools Introduction :
    • Vivado Design Suite
    • SDK
  • Development Flow Introduction
    • Hardware Development
    • Software Development
    • Verification (Simulation and Debug)
    • Downloading the bitstream
Exercise :  Creating the Hardware and the Software to send strings on a serial port
  • Adding an existing IP (from the AMD Xilinx Library) to the design
  • Dealing with interrupts
  • Developing with SDK
  • Debugging with SDK
  • Software profiling
Exercise :  Enhancing the previous Platform (Adding Interrupt Controller, GPIO, RAM)
Exercise :  Developing the software dealing with interrupts
  • Introduction to Chipscope Pro
  • Implementing an AXI monitor into the design to analyze AXI4-Lite Bus transactions
  • Retrieving the on-chip signals waveforms using Chipscope Pro Analyzer
  • Clarifying trigger conditions
Exercise :  Connecting a Chipscope Analyzer to the AXI bus
  • The linux kernel
  • Linux booting, boot Methods
  • Linux OS based application software
Exercise :  Linux Booting through different methods
Exercise :  Debugging a Linux application using SDK Remote profiling
  • Integrating the AXI CDMA
  • Standalone Application
  • Linus OS based Application
Exercise :  Running a Standalone CDMA Application
Exercise :  Running a Linux CDMA Application
  • Creating a Peripheral IP
  • Importing the Peripheral
  • Linux Base Device Driver Development
  • Loading Module into running kernel
  • Application execution
Exercise :  Creating our own Intellectual Property and Device Driver for Linux OS; and executing the application
Durée
2 jours
Renseignements

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Plus d'information

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Les inscriptions aux sessions de formation sont acceptées jusqu'à une semaine avant le début de la formation. Pour une inscription plus tardive nous consulter

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Ce cours peut être dispensé dans notre centre de formation près de Paris ou dans vos locaux, en France ou dans le monde entier.

Les sessions inter-entreprises programmées sont ouvertes dès deux inscrits. Sous condition d'un dossier complet, les inscriptions sont acceptées jusqu'à une semaine avant le début de la formation.

Dernière mise à jour du plan de cours : 20 mai 2026

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